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威盛笔试归来(题目+感想)

12-17 16:01:14 来源:http://www.qz26.com 笔试题目   阅读:8919
导读:今年威盛笔试题目也许不是很难,但是最后我竟没做完(logic部分),感觉题目考察问题很全面,考察的是基础和经验。没有经验和基础,想答好这套题不容易,也让我懂得,想进名企不是那么容易的!我把我能记起来的题目跟大家分享,不全面的希望补充:1. 仲裁器的两种模式算法。设计一个有三个设备的仲裁机制,画图说明,可以用自然语言。(有点基础,根据经验能写就多写 呵呵)2. 序列检测。输出脉冲。(这个题目是最简单的,被我考虑复杂了,竟用了35分钟,555555。题目没看仔细啊!而且卷面勾勾改改,郁闷中)3.可控制信号检测机制,一个组合逻辑,就是与非门、或非门的一个组合逻辑。根据图示,写出一组输入信号,和预期输出信号。(这个题目比较简单。)4. 两头分别是一个触发器,中间是个组合逻辑,根据延迟,确定系统最大频率。并考虑当延迟分别是mindelay和maxdelay时我们要考虑的关键时序问题。(前者我考虑的是建立时间和保持时间是否满足时序要求,后者我考虑组合逻辑延时问题,并说明可以用流水线解决。不一定对或者全面,大家讨论)。
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今年威盛笔试题目也许不是很难,但是最后我竟没做完(logic部分),感觉题目考察问题很全面,考察的是基础和经验。没有经验和基础,想答好这套题不容易,也让我懂得,想进名企不是那么容易的!

  我把我能记起来的题目跟大家分享,不全面的希望补充:

  1. 仲裁器的两种模式算法。设计一个有三个设备的仲裁机制,画图说明,可以用自然语言。(有点基础,根据经验能写就多写 呵呵)

  2. 序列检测。输出脉冲。(这个题目是最简单的,被我考虑复杂了,竟用了35分钟,555555。题目没看仔细啊!而且卷面勾勾改改,郁闷中)

  3.可控制信号检测机制,一个组合逻辑,就是与非门、或非门的一个组合逻辑。根据图示,写出一组输入信号,和预期输出信号。(这个题目比较简单。)

  4. 两头分别是一个触发器,中间是个组合逻辑,根据延迟,确定系统最大频率。并考虑当延迟分别是mindelay和maxdelay时我们要考虑的关键时序问题。(前者我考虑的是建立时间和保持时间是否满足时序要求,后者我考虑组合逻辑延时问题,并说明可以用流水线解决。不一定对或者全面,大家讨论)。

  6.有关fifo的问题。给出波形,考查fifo的概念。以及fifo数据宽度分别为64bits和128bits时的层数。(此题如果设计过fifo估计就比较简单了,我凭感觉做的答案,就不写了,免得大家见笑啊 呵呵)

  做完以上的题目时,我就剩下十分钟了,第七题和第十题都是英文的,估计我看懂也要用5分钟,索性不做了,呵呵!哪位大侠做了,就想想,发个贴子。

  回忆这次笔试经历,我分配时间缺乏经验,时间弄得很紧张。准备也不够充分,看到以往的笔试题,感觉比较简单,等我亲自上考场。才发现不是那么回事。进入威盛,对于我来说也许成为泡影,但我相信自己仍然有机会!!!

  我们那个教室安排了144个人笔试,结果只去了60人左右。不知道什么原因。


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